TTL 電路多余的輸入端的處理方式為：
（1）與門、與非門：多余的輸入端輸入高電平對(duì)邏輯功能無(wú)影響，可做以下方式處理：①將多余的輸入端串聯(lián)限流電阻接高電平（電源 VCC）；②多余的輸入端與有用的輸入端并聯(lián)使用，比如 3 輸入端的與門電路只是用兩個(gè)，可將第三個(gè)沒有使用的輸入端與 1 或 2 并聯(lián)使用；③多余的輸入端直接懸空，由 TTL 電路可知，直接懸空也是相當(dāng)于輸入高電平的，因此可直接懸空；④多余的輸入端串聯(lián)大于 1kΩ的電阻接地，串聯(lián)大于 1kΩ的電阻接地也是相當(dāng)于輸入高電平，因此，從原理上來(lái)說(shuō)也是可以。但是為了提高電路可靠性，提高 TTL 電路的抗干擾能力，最好不要采用直接懸空或串聯(lián)大于 1kΩ的電阻接地的方法。
（2）或門、或非門：多余的輸入端輸入低電平對(duì)邏輯功能無(wú)影響，可做以下方式處理：①接低電平（地）；②串聯(lián)小于 1kΩ電阻接地。注意：串聯(lián)電阻應(yīng)遠(yuǎn)小于 1kΩ以提高抗干擾能力。最好方法直接接地即可。這時(shí)多余的輸入端是不允許懸空的，懸空相當(dāng)于高電平就會(huì)影響邏輯功能。
拓展：CMOS 邏輯電路多余的輸入端是絕對(duì)不允許懸空處理的！
CMOS 邏輯電路，內(nèi)部是由 MOS 管電路組成的，MOS 管是壓控元件，其控制端電流很小，輸入阻抗極高，多余的輸入端懸空很容易受到外界的干擾。
總結(jié)：TTL 邏輯電路多余的輸入端在不影響邏輯功能的的情況下是可以懸空處理的，但是為了養(yǎng)成習(xí)慣和提高電路可靠性，輸入端最好不要懸空；而 CMOS 邏輯電路多余的輸入端完全不允許懸空處理，會(huì)直接受到干擾而影響功能。
ttl 電路
TTL 電路中的 TTL 是 Transistor-Transistor-Logic 的英文縮寫，指的是晶體管邏輯電路。
TTL 邏輯電路，內(nèi)部是由晶體三極管電路組成的，其輸入端由發(fā)射極輸入，根據(jù) TTL 電路的特性可知，只有當(dāng)輸入電壓小于三極管的閾值電壓 UTH 時(shí)，三極管才導(dǎo)通，也就是說(shuō)輸入低電平時(shí)三極管才導(dǎo)通；當(dāng)輸入高電平時(shí)，由于 BE 無(wú)壓差或壓差小于 UTH，三極管截止。由三極管的阻抗特性可知，當(dāng)輸入端串聯(lián)電阻時(shí)，會(huì)影響 TTL 電路的輸入電壓，當(dāng)輸入端串聯(lián)電阻大于 1kΩ時(shí)，即使串聯(lián)電阻后接地，其輸入端的電壓相當(dāng)于高電平，三極管是截止的。也就是說(shuō)，即使輸入端懸空，也相當(dāng)于認(rèn)為高電平狀態(tài)。
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